FFB03812VN
2016/8/2 8:58:25
0 人气:12
- 型号:FFB03812VN
- 数量:1000
- 制造商:上海曦龙电气设备有限公司
- 有效期:2017/8/2 0:00:00
FFB03812VN
工业风扇代理销售:
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锅炉风机在设计时是按工况来考虑的,在实际使用中有很多时间风机都需要根据实际工况进行调节,传统的做法是用开关风门、阀门的方式进行调节,这种调节方式增大了供风系统的节流损失,在启动时还会有启动冲击电流,且对系统本身的调节也是阶段性的,调节速度缓慢,减少损失的能力很有限,也使整个系统工作在波动状态;而通过在锅炉风机上加装变频调速器(装置)则可一劳永逸的解决好这些问题,可使系统工作状态平缓稳定,并可通过变频节能收回投资。锅炉的变频改造方案一例如下:
锅炉风机的装机概况:2×75KW,1×55KW。
所有风机均采用一对一(即 一台变频器配一台电机)的配置 方式,保留原工频系统且与变频系统互为备用,一般情况下的调 节方式均为开环调节。
二、投资与节能:
变频节能系统(装置)在各类调速系统中使用时其节能效果对于单台设备可做到20-55%,在风机这类设备的一般应用的节能效果平均也可做到20-50%,在未受到其它因素的影响的情况下一般可取平均值,这些节能效果平均值是由实际应用中得到,权威性数据可由市场上公开出售的资料(书)查到;通过这些数据再进行一些简单的投资回收率的计算可知:变频节能系统(装置)的投资回收期一般为6-15个月(这是经验值也是权威数据)。
水泥行业风机工作介质中常含有一定量大小不等、形状各异的同体颗粒,如除尘系统的引风机、气力输送的鼓风机。由于这些风机是在含尘气流中工作的,气流中的粉尘颗粒既要对风机产生磨损,又要在风机叶片上附着积灰,且这种磨损和积灰都是不均匀的。因而使风机转子的平衡遭到破坏,引起风机振动,缩短风机寿命,严重时可使风机不能正常工作。尤其是风机叶片的磨损为严重,它不仅破坏风机内的流动特性,且容易引发叶片断裂及飞车等重大事故。
传动部位磨损也是风机普遍存在的问题,其中包括各种轴类、辊类、减速机、电机、泵类等轴承位、轴承座、键槽及螺纹等部位,传统的补焊机加工方法易造成材质损伤,导致部件变形或断裂,具有较大的局限性;刷镀和喷涂再机加工的方法往往需要外协,不仅修复周期长、费用高,而且因修补的材料还是金属材料,不能从根本上解决造成磨损的原因(金属抗冲击能力及退让性较差);更有许多部件只能采取报废更换,大大增加了生产成本和库存备件,使企业良好的资源优势遭到闲置和浪费。
振动故障:
风机与电动机之间由联轴器链接,传递运动和转矩。不对中是风机常见的故障,风机的故障60%与不对中相关。风机的不对中故障是指风机、电动机两转子的轴心线与轴承中心线的倾斜或偏移程度。风机转子的不对中可以分为联轴器不对中和轴承不对中。风机转子系统产生不对中故障后,在旋转过程中会产生一系列对设备运行不利的动态效应,引起联轴器的偏转、轴承的磨损、油膜稳态和轴的挠曲变形等,不仅使转子的轴颈与轴承的相互位置和轴承的工作状态发生了变化,也同时降低了轴系的固有频率,使转子受力及轴承所受的附加力导致风机的异常振动和轴承的早期损坏,危害极大。对于风机的不对中故障,可以用激光对中仪来解决,方便快捷。
原因分析
总结风机故障现象及原因,有其规律可循,风机故障按其原因及分类,有以下几种:
设计原因:
设计不当,动态特性不良,运行时发生强迫振动或自激振动
结构不合理,应力集中
设计工作转速接近或落入临界转速区
热膨胀量计算不准,导致热态对中不良
制造原因:
零部件加工制造不良,精度不够
零件材质不良,强度不够,制造缺陷
转子动平衡不符合技术要求
由于VHDL语言已作为一种IEEE的工业标准,因而其语言标准、规范、语法比较严格,易于共享和复用。而且,VHDL设计技术齐全、方法灵活、支持广泛。目前大多数EDA工具几乎在不同程度上都支持VHDL语言。
2 CPLD外部引脚说明
该方案中所用的芯片是Xilinx公司的CPLD 9500系列芯片,其类型为XC95108-7 PC84。这种芯片共有84个外部引脚,其中5个引脚接地,6个引脚接电源,4个引脚用于JTAG,剩下的引脚为I/O引脚。根据EISA总线的信号特征和信源的要求,该芯片所使用的外部引脚为如图1所示。
图1中输入信号:
DATA_IN 15~0 输入的数据信号
ADDRESS 15~0 输入的地址信号
RESET 复位信号
AEN 地址允许信号
CLK 输入时钟信号
IOW I/O写信号
输出信号:
IO_CS 16位I/O片选信号
DATA_OUT 7~0 输出的数据信号
DEN 输出数据使能信号
DCLK 输出数据时钟信号
3 系统整体设计
系统启动后,主机向I/O口发出地址信号。AEN为低电平时,系统进行地址译码。译码成功后,产生一使能信号ENABLE打开数据暂存单元。数据到来后,数据暂存单元将总线上的16位并行数据锁存在暂存器中,同时产生一允许信号PERMIT,允许进行数据格式转换。接下来系统根据当前所处的状态进行选择输出,完成格式的转换,并产生相应的输出数据使能信号DEN和输出数据时钟信号DCLK。整个过程结束后,将各信号复位,开始新的转换周期。因此,整个系统应包括五个逻辑部分:地址译码、数据暂存、状态控制、复位控制、转换输出。
3.1 系统的整体框图
系统的整体框图如图2所示。
3.2 系统的工作时序
转换过程的时序如图3所示。
4 VHDL语言描述
4.1 各单元模块的描述
·地址译码单元
计算机与I/O设备间的正确通信是通过对I/O空间的寻址操作来完成的。每个I/O端口都分配了一个地址。在该方案中,将端口的地址设定为0280H,采用完全译码的方式。同时为了避免DMA操作控制总线,设计时让aen亦参与译码,并由时钟信号进行触发控制。译码成功后,产生一使能信号enable(高电平有效),同时将io_cs信号拉低。
·数据暂存单元
enable信号无效时,数据暂存单元为高阻状态。该信号和写信号iow(低电平有效)都变为有效后,在接下来的一个时钟的下降沿(确保采样时数据有效),将总线上的数据读入数据暂存单元,并产生一允许信号permit,允许系统进行格式转换。
·状态控制单元
这是系统的控制部分。系统状态的控制是由系统的控制信号simbol、sign在时钟信号的驱动下实现的。系统每完成一次8位数据的输出,在同一时钟的下降沿,状态发生改变,产生另外一控制信号varb(低电平有效)。复位后,系统又回到初始状态。状态变化过程如下:
- 电话:13918864473
- 传真:021-61318625
- email:937926739@qq.com
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